Senior Test Engineer, Semiconductor, ATE
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- auf Anfrage
- 81476 München
- Weltweit
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- 30.12.2024
Kurzvorstellung
I have 25 years of Experience with ATE on 93k and Teradyne in fields of logic, mixed Signal and DRAM. Volumes of total 1k for mp3 player jackets up to millions per week in DRAM business. Program and Hardware generation up to installation in Asia.
Qualifikationen
Projekt‐ & Berufserfahrung
Leitung (Festanstellung)
intern, München
5/2022
–
3/2023
(11 Monate)
Tätigkeitszeitraum
5/2022 – 3/2023
Tätigkeitsbeschreibungprobe PCB entwicklung für signale bis 20Gbps mit Layout in Indien und Co- simulation in Boise
Eingesetzte QualifikationenHardware-Design
Ausbildung
Diplom Ingenieur
Diplom
TUM
1996
München
München
Diplom Ingenieur (FH)
Diplom
FH München
1990
München
München
Über mich
From test program development according to spec to yield monitoring and throughput increase to FAR handling and feedback to production site.
From hardware planing to offload the pcb production to high speed pcb development with simulation feedback for data eye improvement.
To self build desktop tester improvement with peltier temp forcing system and socket manipulation with local hardware shop.
From hardware planing to offload the pcb production to high speed pcb development with simulation feedback for data eye improvement.
To self build desktop tester improvement with peltier temp forcing system and socket manipulation with local hardware shop.
Persönliche Daten
Sprache
- Deutsch (Muttersprache)
- Englisch (Fließend)
Reisebereitschaft
Weltweit
Arbeitserlaubnis
- Europäische Union
Profilaufrufe
232
Alter
60
Berufserfahrung
26 Jahre und 3 Monate
(seit 10/1998)
Projektleitung
10 Jahre
Kontaktdaten
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